PLD

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관련 문서: CPLD

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}}}}}}}}} ||

1. 개요2. 종류

2.1. SPLD

2.1.1. PROM2.1.2. PLA2.1.3. PAL2.1.4. GAL

2.2. CPLD2.3. FPGA

1. 개요

PLD(Programmable Logic Device)

프로그래밍을 통해 특정한 논리 회로로 구성하여 사용할 수 있는 집적 회로.

초창기 PLD는 퓨즈 방식으로 제조되어 일회용이었으나, 이후 등장한 CPLD 및 FPGA 등의 소자는 메모리를 사용하여 여러 번 프로그래밍이 가능하다.

2. 종류

2.1. SPLD

SPLD(Simple Programmable Logic Device)

몇 개에서 수십 개 정도의 입출력이 연결된 간단한 PLD를 통칭하여 SPLD라고 부르기도 한다.

2.1.1. PROM

자세한 내용은 ROM 문서

#!if (문단 == null) == (앵커 == null)
를

#!if 문단 != null & 앵커 == null
의 [[ROM#s-|]]번 문단을

#!if 문단 == null & 앵커 != null
의 [[ROM#|]] 부분을

참고하십시오.
PROM(Programmable Read-Only Memory)

2.1.2. PLA

PLA(Programmable Logic Array)

프로그래밍 가능한 AND 게이트 및 OR 게이트를 격자 형태로 배치하여 SoP(Sum of Product) 형식의 논리 함수를 구현할 수 있는 PLD의 일종.

2.1.3. PAL

PAL(Programmable Array Logic)

프로그래밍 가능한 AND 게이트 및 입력이 고정된 OR 게이트를 격자 형태로 배치하여 SoP(Sum of Product) 형식의 논리 함수를 구현할 수 있는 PLD의 일종.

2.1.4. GAL

GAL(Generic Array Logic)

Lattice에서 개발한 PAL과 유사한 구조의 PLD.

2.2. CPLD

자세한 내용은 CPLD 문서

#!if (문단 == null) == (앵커 == null)
를

#!if 문단 != null & 앵커 == null
의 [[CPLD#s-|]]번 문단을

#!if 문단 == null & 앵커 != null
의 [[CPLD#|]] 부분을

참고하십시오.
CPLD(Complex Programmable Logic Device)

수십 ~ 수천 개 정도의 (주로 PAL 구조의) '매크로셀'이 내장된 PLD. 일반적으로 재기록 가능한 비휘발성 메모리를 사용하여 논리 셀을 구성하며, Altera의 MAX V 시리즈와 같이 비휘발성 메모리가 내장된 (작은 규모의) FPGA를 CPLD로 분류하기도 한다.

2.3. FPGA

자세한 내용은 FPGA 문서

#!if (문단 == null) == (앵커 == null)
를

#!if 문단 != null & 앵커 == null
의 [[FPGA#s-|]]번 문단을

#!if 문단 == null & 앵커 != null
의 [[FPGA#|]] 부분을

참고하십시오.
FPGA(Field Programmable Gate Array)

SRAM 메모리 값을 설정하여 진리표 및 배선을 구성하는 방식의 PLD 디바이스로 다른 PLD에 비해 유연하게 회로를 구성할 수 있다. 일반적으로 SPLD, CPLD보다 규모가 크며 복잡한 디지털 회로를 구성하는 데 사용된다.